Gerente de Validação de Silício at Synopsys

Linguagem

Localização: Oeiras
Nível: lead/mgmt
Publicado: 28 de ago. de 2026

Descrição

A Synopsys está contratando um Gerente de Engenharia de Validação de Silício Analógico de Alta Velocidade em Lisboa para liderar as operações de validação de silício para IP analógico de alta velocidade. A função gere recursos de laboratório, testes e caracterização de SerDes, depuração de silício, relatórios de validação, hardware de teste personalizado e uma equipa de engenheiros, colaborando com as áreas de design, aplicações e gestão de produto. Os candidatos precisam de pelo menos cinco anos de experiência em validação de silício analógico ou de sinais mistos, experiência na gestão de equipas, um diploma relevante em engenharia, sólidos conhecimentos de circuitos analógicos e SerDes, familiaridade com protocolos e competências de programação em MATLAB, Python ou ferramentas equivalentes.

Habilidades necessárias

Validação de silício
Validação de SerDes
Integridade do sinal
Automação de testes
MATLAB
Python
Testes de FPGA
Verilog
VHDL

Informações adicionais

Minimum Education: Degree in Electronic Engineering, Electrical Engineering, or a related technical discipline
Required Previous Experiences: 5+ years of silicon validation, test, or characterization experience for analog or mixed-signal integrated circuits
Experience managing technical teams, including project planning, resource allocation, performance evaluation, and engineer development
Experience building team capability and delivering results while maintaining technical quality standards
Experience with FPGA-based test systems and familiarity with Verilog or VHDL for custom test logic
Preferred Qualifications: Experience with FPGA-based test systems and familiarity with Verilog or VHDL for custom test logic

Sobre a Synopsys

Synopsys

AI Infrastructure

Synopsys delivers comprehensive silicon-to-systems solutions that help innovators accelerate development, reduce risk, and drive breakthroughs.

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